1.原理圖常見錯誤：
（1）ERC報告管腳沒有接入信號：
a. 創(chuàng)建封裝時給管腳定義了I/O屬性；
b.創(chuàng)建元件或放置元件時修改了不一致的grid屬性，管腳與線沒有連上；
c. 創(chuàng)建元件時pin方向反向，必須非pin name端連線。
（2）元件跑到圖紙界外：沒有在元件庫圖表紙中心創(chuàng)建元件。
（3）創(chuàng)建的工程文件網絡表只能部分調入PCB：生成netlist時沒有選擇為global。
（4）當使用自己創(chuàng)建的多部分組成的元件時，千萬不要使用annotate.
2.PCB中常見錯誤：
（1）網絡載入時報告NODE沒有找到：
a. 原理圖中的元件使用了PCB庫中沒有的封裝；
b. 原理圖中的元件使用了PCB庫中名稱不一致的封裝；
c. 原理圖中的元件使用了PCB庫中pin number不一致的封裝。如三極管：sch中pin number 為e,b,c, 而PCB中為1，2，3。
（2）打印時總是不能打印到一頁紙上：
a. 創(chuàng)建PCB庫時沒有在原點；
b. 多次移動和旋轉了元件，PCB板界外有隱藏的字符。選擇顯示所有隱藏的字符， 縮小PCB, 然后移動字符到邊界內。
（3）DRC報告網絡被分成幾個部分：
表示這個網絡沒有連通，看報告文件，使用選擇CONNECTED COPPER查找。
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溫馨提示：
凡在本公司進行電路板克隆業(yè)務的客戶，必須有合法的PCB設計版權來源聲明，以保護原創(chuàng)PCB設計版權所有者的合法權益；